课程培训
赛灵思新的Vitis统一软件开发平台培训

课程安排

第一天上午 介绍Vitis, Ultra96开发板和入手实验

1. Vitis软件平台原理、软件界面和开发流程介绍,包括各组件功能、软件安装、软件和硬件仿真、相关工具VivadoPetalinuxHLS和SDK及它们之间的关系。

2. Ultra96开发板介绍,镜像安装和升级,硬件搭建和网络配置。

3. Vitis创建Hello WorldMemory、设备测试和FSBL镜像启动等项目并在开发板上运行

第一天下午 介绍HLS C++硬件加速和IP封装原理、HLS软件,并通过GUI和Tcl 创建HLS若干实验,熟悉了解HLS技术

1. Vivado HLS硬件加速原理、开发流程、HLS软件、加速方法pipeline和unroll。

2. 使用Vivado HLS GUI界面创建HLS C++项目,C仿真验证,高水平综合,RTL验证并打包成IP核。

3. 学习Tcl命令,使用Tcl命令创建、验证、综合和打包HLS C++项目,并比较不同优化方法的LatencyInterval和资源利用率。

4. (选项)学习使用IP集成器设计调用和打包IP核,创建一个项目包含Tcl生成的两个IP核,调用一个Xilinx FFT IP核,打包并验证设计。

第二天上午 学习Xilinx定制嵌入式Linux软件工具Petalinux软件及重要概念

1、Petalinux开发软件、控制文件、开发命令和开发流程介绍,。

2、构建底层工具Make命令、MakefileCMakeAutotools概念、程序和实验。

3、使用Petalinux生成最简Ultra96 Linux系统。

4、(选项)构建PetaLinux软件的Yocto架构和BitBake工具学习和实验。

第二天下午 定制一个完整的Ultra96v2异构加速平台。

实验设计制作Wifi和DPU功能的Ultra96v2 Vitis异构加速平台,以下内容各约一个小时

1. 使用vivado设计Wifi和DPU功能的Ultra96v2硬件平台。

2. 使用Petalinux定制含Wifi和DPU功能的Ultra96v2 Linux软件平台。

3. 使用Vitis设计含Wifi和DPU功能的Ultra96v2 异构加速平台

第三天 学习使用Vitis软件GUI和命令行开发基于RTL、C、C++OpenCL C的FPGA硬件加速项目,进行评估、分析和优化,部分实验ultra96开发板上运行

实验一、使用Vitis创建RTL向量加法器项目,并运用Vitis Analyzer对时间线和DDR传输性能进行分析。

实验二、 使用Vitis C++/OpenCL分别使用界面方法和使用命令行创建向量加法器项目,由Vitis调用Vivado HLS生成硬件kernel,运行仿真,并在开发板上进行测试。

实验三、使用HLS常用优化方法对前面的实验项目进行优化和仿真,用Vitis Analyzer获得HLS报告,分析观察优化前后的加速器运行状态和性能

实验四、介绍Vitis Opencv硬件加速库和Streaming技术,创建加速项目对图像进行缩放和高斯滤波等处理。

实验五、(选项)用Vitis设计数字滤波器有限长单位冲激响应(FIR)滤波器,并进行软件和硬件仿真。




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